2010, ISBN: 9781441943415
Mitwirkende: Gupta, Aarti, Springer, Taschenbuch, Auflage: Softcover reprint of hardcover 1st ed. 2007, 360 Seiten, Publiziert: 2010-11-19T00:00:01Z, Produktgruppe: Buch, 1.12 kg, CAD & C… Mehr…
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Softcover reprint of hardcover 1st ed. 2007 Kartoniert / Broschiert Elektrotechnik, Computer-Aided Design (CAD), algorithms; complexity; computer-aideddesign(CAD); designprocess; Model;… Mehr…
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SAT-Based Scalable Formal Verification Solutions (Integrated Circuits and Systems) - Taschenbuch2010, ISBN: 9781441943415
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Bibliographische Daten des bestpassenden Buches
Autor: | |
Titel: | |
ISBN-Nummer: |
Detailangaben zum Buch - SAT-Based Scalable Formal Verification Solutions (Integrated Circuits and Systems)
EAN (ISBN-13): 9781441943415
ISBN (ISBN-10): 1441943412
Gebundene Ausgabe
Taschenbuch
Erscheinungsjahr: 2010
Herausgeber: Springer
360 Seiten
Gewicht: 0,544 kg
Sprache: eng/Englisch
Buch in der Datenbank seit 2011-10-21T18:36:02+02:00 (Berlin)
Detailseite zuletzt geändert am 2023-08-03T13:27:05+02:00 (Berlin)
ISBN/EAN: 9781441943415
ISBN - alternative Schreibweisen:
1-4419-4341-2, 978-1-4419-4341-5
Alternative Schreibweisen und verwandte Suchbegriffe:
Autor des Buches: mala gupta
Titel des Buches: solutions, sat
Daten vom Verlag:
Autor/in: Malay Ganai; Aarti Gupta
Titel: Integrated Circuits and Systems; SAT-Based Scalable Formal Verification Solutions
Verlag: Springer; Springer US
330 Seiten
Erscheinungsjahr: 2010-11-19
New York; NY; US
Gedruckt / Hergestellt in Niederlande.
Sprache: Englisch
117,69 € (DE)
120,99 € (AT)
130,00 CHF (CH)
POD
XXX, 330 p. 118 illus.
BC; Hardcover, Softcover / Informatik, EDV/Anwendungs-Software; Computer-Aided Design (CAD); Verstehen; algorithms; complexity; computer-aided design (CAD); design process; model; modeling; Computer-Aided Engineering (CAD, CAE) and Design; Electronic Circuits and Systems; Electrical and Electronic Engineering; Schaltkreise und Komponenten (Bauteile); Elektrotechnik; BB; EA
Design Verification Challenges.- Design Verification Challenges.- Background.- Basic Infrastructure.- Efficient Boolean Representation.- Hybrid DPLL-Style SAT Solver.- Falsification.- SAT-Based Bounded Model Checking.- Distributed SAT-Based BMC.- Efficient Memory Modeling in BMC.- BMC for Multi-Clock Systems.- Proof Methods.- Proof by Induction.- Unbounded Model Checking.- Abstraction/Refinement.- Proof-Based Iterative Abstraction.- Verification Procedure.- SAT-Based Verification Framework.- Synthesis for Verification.Describes SAT-based model checking approaches and gives engineering details on what makes model checking practical Techniques covered can be synergistically combined into a scalabe solution Focuses on engineering design and not mathematics Includes supplementary material: sn.pub/extras
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